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TMS32C6414EZLZ5E0 -テキサス・インスツルメント-固定小数点ディジタル信号プロセッサ

TMS32C6414EZLZ5E0 -テキサス・インスツルメント-固定小数点ディジタル信号プロセッサ

TMS32C6414EZLZ5E0 - Texas Instruments - FIXED-POINT DIGITAL SIGNAL PROCESSORS

商品の詳細:

起源の場所: フィリピン
ブランド名: Texas Instruments
証明: Lead free / RoHS Compliant
モデル番号: TMS32C6414EZLZ5E0

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最小注文数量: 5枚
価格: Contace sales group 1
パッケージの詳細: 標準パッケージ
受渡し時間: 2-3 日間
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供給の能力: 5000
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詳細製品概要

速い細部:

 

固定小数点ディジタル信号プロセッサ

 

 

記述:

 

TMS320C64x™ DSPs は(を含む TMS320C6414、TMS320C6415 および TMS320C6416 装置) TMS320C6000™ DSP のプラットホームの高性能定点 DSP の生成です。 TMS320C64x™ (C64x™の†)装置はこれらに DSPs を作るテキサス・インスツルメント (TI) によって開発される VelociTI™の非常長指示単語の (VLIW) の第二世代の高性能の、高度の建築(VelociTI.2™)に多重チャンネルおよび多機能の適用のための優秀な選択基づいています。 C64x™は C6000™ DSP のプラットホームのコード互換性があるメンバーです。 720 の MHz のクロック レートの毎秒 (MIPS) 5760まで ,000,000 の指示の性能を使って、高性能 DSP のプログラミングの挑戦への C64x 装置提供の費用効果が大きい解決。 C64x DSPs は高速コントローラーの操作上の柔軟性およびアレー・プロセッサの数機能を所有しています。

C64x™ DSP の中心プロセッサに— VelociTI.2™延長の… 32ビット結果および 6 つの演算論理単位 (ALUs) のための 32ビット ワード長そして 8 つの非常に独立した機能単位2 の乗数の 64 の汎用レジスターがあります。 8 つの機能ユニットの VelociTI.2™延長は主適用の向上させ、VelociTI™の建築の平行を拡張する新しい指示を含んでいます。 C64x は増加集めます合計毎秒(MMACS) 2880,000,000 のレインコートのための周期ごとの (MACs)、または合計 5760 MMACS のための周期ごとの 8 つの 8ビット レインコートを 16 ビット 4 を作り出すことができます。 C64x DSP にまたアプリケーション特有のハードウェア論理、オン破片の記憶および他の C6000™ DSP のプラットホーム装置と同じような付加的なオン破片ペリフェラルがあります。

C6416 装置は備えています 2 つの高性能埋め込まれたコプロセッサ[Viterbi のデコーダーのコプロセッサ(VCP)をおよびターボ デコーダーのコプロセッサ(TCP)] それはかなりチャネル解読操作のオン破片のスピードをあげます。 缶分けによる4 CPU の時計で作動する VCP は 600 の 7.95 キロビット/秒の適応性がある複数のレート (AMR) の[K = 9、R = 1/3]声チャネルに解読します。 VCP は抑制の長さを K = 5、6、7、8、および 9、率 R = 1/2、1/3、および 1/4、および適用範囲が広い整式、難しい決定または柔らかい決定を発生させている間支えます。 CPU の時計で作動する TCP

缶分けによって2 四十三 384 キロビット/秒までか 7 2-Mbps ターボを符号化されたチャネル解読して下さい(6 つの繰り返しを仮定する)。 TCP は max*log-map のアルゴリズムを実行し、十分にターボ プログラム可能なフレームの長さおよび interleaver との第三世代のパートナーシップのプロジェクトによって(3GPP および 3GPP2)、必要なすべての整式および率を支えるように設計されています。 変数は繰り返しの数のような解読し、規準を停止することまたプログラム可能です。 VCP/TCP と CPU 間のコミュニケーションは EDMA のコントローラーを通して遂行されます。

C64x は二レベルの隠し場所ベースの建築を使用し、強力で、多様な一組のペリフェラルがあります。 レベル 1 プログラム隠し場所(L1P)は 128-Kbit 直接地図を描かれた隠し場所およびレベル 1 データ隠し場所(L1D)です 128-Kbit 両方向のセット連想隠し場所です。 レベル 2 の記憶/隠し場所(L2)はプログラムとデータ空間の間で共有される 8-Mbit メモリ・スペースから成っています。 L2 記憶は隠し場所(256K バイトまで)および地図を描かれた記憶の地図を描かれた記憶か組合せとして形成することができます。 周辺セットは 3 つの多重チャンネルの緩衝されたシリアル ポート(McBSPs)を含んでいます; 8ビット普遍的なテストおよび操作 PHY は非同期転送モードの (ATM) の奴隷[ユートピアの奴隷]港(C6415/C6416 だけ)のためにインターフェイスします; 3 つの 32ビット一般目的のタイマー; ユーザー構成可能の 16 ビットか 32ビット ホスト港インターフェイス(HPI16/HPI32); 周辺コンポーネントの結合 (PCI) [C6415/C6416 だけ]; 16 の GPIO ピンが付いている一般目的入出力港(GPIO); そして同期および非同期記憶およびペリフェラルにインターフェイスすることができる 2 つの glueless 外的な記憶インターフェイス(64 ビット EMIFA および 16 ビット EMIFB の‡)。

C64x に下記のものを含んでいる開発ツールの大ぞろいがあります: C64x 特定の強化の高度の C コンパイラ、そして Windows™のデバッガー インターフェイス ソース コード実行に可視性のためのプログラムし、予定し簡単にするアセンブリ オプティマイザ。

 

 

適用:

 

-- 高性能固定小数点デジタル

プロセッサ信号命令(DSPs)

− 2、1.67-、1.39 ns 命令サイクルの時間

− 500-、600-の 720 MHz クロック レート

− 8 の 32ビット指示/周期

− 28 操作/周期

− 4000、4800、5760 の MIPS

C62x™とソフトウェア互換性がある−十分に

Pin 互換性がある− C6414/15/16 装置

-- VelociTI™への VelociTI.2™延長

高度の非常長指示単語

(VLIW) TMS320C64x™ DSP の中心

VelociTI.2™延長の− 8 の非常に独立した機能ユニット:

−は 6 ALUs (32 /40 ビット)、それぞれ単一の 32ビットの、二重 16 ビットを支えるか、または時計サイクルごとの 8ビット算術を四つ揃えにします

− 2 の乗数サポート

16 ビット 4 16 x は増加します

(32ビット結果)時計サイクルごとにまたは

8ビット 8 8 つ x は増加します

(16 ビットの結果)時計サイクルごとに

−の非同盟の負荷店の建築

− 64 の 32ビット汎用レジスター

−の指示のパッキングはコード サイズを減らします

−条件付きすべての指示

-- 命令セットの特徴

バイト アドレス指定可能な− (8 /16 /32 /64 ビット データ)

−の 8ビット流出の保護

−ビット分野のエキス、セット、ゆとり

−の標準化、ビット数える飽和

−の VelociTI.2™によって高められる直交性

-- Viterbi のデコーダーのコプロセッサ(VCP) [C6416]

600 7.95 キロビット/秒 AMR 上の−サポート

−のプログラム可能なコード パラメータ

-- ターボ デコーダーのコプロセッサ(TCP) [C6416]

−は支えます 7 つ 2-Mbps か 43 384 キロビット/秒まで 3GPP (6 つの繰り返し)

−のプログラム可能なターボ コードおよび解読変数

-- L1/L2 記憶建築

− 128K ビット(16k バイトの) L1P プログラム隠し場所(地図を描かれる指示して下さい)

− 128K ビット(16k バイトの) L1D データは貯蔵します(両方向のセット連想)

− 8M ビット(1024K バイト) L2 は統一しました地図を描かれた RAM/Cache (適用範囲が広い割振り)を

-- 2 つの外的な記憶インターフェイス(EMIFs)

64 ビット− 1 (EMIFA)、16 ビット 1 (EMIFB)

非同期への−の Glueless インターフェイス

記憶(SRAM および EPROM)

同期記憶(SDRAM、

SBSRAM、ZBT SRAM、および先入れ先出し法)

− 1280M バイトの合計のアドレス指定可能で外的なメモリ・スペース

-- 高められた直接記憶アクセス (EDMA)

コントローラー(64 の独立したチャネル)

-- ホスト港インターフェイス (HPI)

−ユーザー構成可能バス幅(32 /16 ビット)

-- 32 Bit/33 MHz、マスター・スレーブ 3.3-V PCI

インターフェイスは PCI の指定 2.2 に合致します

[C6415/C6416]

− 3 PCI バス アドレス・レジスター:

Prefetchable の記憶

非Prefetchable 記憶入力/出力

−の四線式連続 EEPROM インターフェイス

DSP の下の− PCI の割込み要求

プログラム制御

PCI 入力/出力周期による− DSP 割り込み

--3 つの多重チャンネルの緩衝されたシリアル ポート

T1/E1、MVIP の SCSA の企画者への−直接 I/F

256 のチャネルまでの−それぞれ

AC97 互換性がある−の ST バス切換え

−の連続周辺機器インターフェイス (SPI)

互換性がある(Motorola™)

 3 つの 32ビット一般目的のタイマー

 普遍的なテストおよび操作 PHY

自動支払機(ユートピア)のためのインターフェイス[C6415/C6416]

−のユートピアのレベル 2 奴隷自動支払機のコントローラー

8ビット−は操作を送受信します

方向ごとの 50 までの MHz

−のユーザー定義の細胞のフォーマット 64 バイトまで

 16 の一般目的入力/出力 (GPIO) ピン

 適用範囲が広い PLL のクロック発振器

 IEEE-1149.1 (JTAG の†)

境界スキャン互換性がある

-- 532 Pin 球の格子配列の (BGA) のパッケージ

(GLZ、ZLZ および CLZ の接尾辞)、0.8 mm 球

ピッチ

 0.13 µm/6 レベルの CU の金属プロセス(CMOS)

 3.3-V I/Os、内部 1.2-V/1.25-V (500 の MHz)

 3.3-V I/Os、内部 1.4-V (600 そして 720 の MHz)

 

 

指定:

 

データ用紙

TMS320C6414-16

プロダクト写真

532-FCBGA-ZLZ

標準パッケージ

60

部門

集積回路 (ICs)

家族

埋め込まれて- DSP (ディジタル信号プロセッサ)

シリーズ

TMS320C6414T/15T/16T

包装

タイプ

固定小数点

インターフェイス

ホスト インターフェイス、McBSP

クロック レート

500MHz

不揮発性メモリ

外的

オン破片の RAM

1.03MB

電圧-入力/出力

3.30V

電圧-中心

1.20V

実用温度

0°C | 90°C

土台のタイプ

表面の台紙

パッケージ/場合

532-BFBGA、FCBGA

製造者装置パッケージ

532-FCBGA (23x23)

 

 

比較優位:

 

保証: 180 日!
自由な船積み: $1000 勝利上の順序自由な郵送物料金
(3Kg の下の商品の重量)、20130901-20130930 の間に。


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